S3C44B0X处理器体系结构分析课件.ppt
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- 关 键 词:
- S3C44B0X 处理器 体系结构 分析 课件
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1、123A photo of ARM-R44B0X-002(S3C44B0X)Summarize of S3C44B0X45678910AHB总线互连结构图 11121314151617181920212223242526272829303132333435363738394041JTAG是Joint Test Action Group的缩写;是IEEE1149.1标准42434445464748495051 52+5V位驱动第0位第1位第2位第3位第4位阳极abcdefgDPPF0图5-4 LED显示扫描和驱动电路ULN2803A段驱动PF7PG0.PG7第5位第6位第7位5354555657
2、REGBANK具有18个可编程寄存器,用于配置LCD控制器LCDCDMA为专用DMAVIDPRCS 从LCDCDMA 接收数据,将相应格式的数据通TIMEGEN包含可编程的逻辑 TIMEGEN部分产生VFRAME,VLINE,VCLK,VM等信号。585960616263646566类型FIFO类型非FIFO模式Rx中断每当接收数据达到接收FIFO触发的水平,就产生接收中断;如果FIFO非空且连续3个字时间没有接收到任何数据,就产生超时中断;每当接收数据满,接收移位寄存器将产生一个中断;Tx中断每当发送数据达到发送FIFO触发的水平,就产生发送中断;每当发送数据空,发送保持寄存器将产生一个中断
3、;错误中断帧错误、奇偶校验错误和被检测到并按字节接收的中止信号,都将产生错误中断;当达到接收FIFO的顶部,就会产生溢出错误中断;所有错误都会立即产生一个错误中断。但两个错误同时发生,只有一个中断会产生;6768ULCONn位描述初始值保留7 0红外线模式6该位确定是否使用红外通信模式0:正常模式 1:红外收发模式0奇偶校验模式5:3 该位确定奇偶如何产生和校验0 xx:无校验位 100:奇校验 101:偶校验 110:校验位强制/检测置1 111:校验位强制/检测置0000停止位的数量2该位确定停止位的个数,0:1位停止位 1:2位停止位0数据位长度1:0该位确定数据位的个数00:5位 01
4、:6位 10:7位 11:8位0069UCONn位描述初始值发送中断类型9发送中断请求类型0:脉冲(在发送缓冲区变空时立即引发中断)1:电平(在发送缓冲区为空时引发中断)0接收中断类型8接收中断请求类型0:脉冲(接收缓冲区接收到数据时立即引发中断)1:电平(接收缓冲区正在接收数据时引发中断)0接收超时中断使能7在UART的FIFO使能的情况下,使能禁止接收超时中断 0:禁止 1:使能0接收错误状态中断使能6使能UART在接收操作中发生错误时的错误中断响应0:不产生错误状态中断 1:产生错误状态中断0回送模式5该位使UART自动进入回送模式0:正常操作 1:回送模式0发送中止信号4 该位将引发U
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