配套课件-计算机导论.ppt
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1、2.1 逻辑代数2.2 数字电路2.3 内存储器2.4 中央处理器2.5 外部设备第二章 计算机硬件组成与工作原理计算机系统包括硬件和软件两部分,如图2-1所示。计算机出现至今,其系统发展迅速,但是基本硬件组成与工作原理仍然是冯诺依曼型计算机。冯诺依曼型计算机具有如下特点:(1)包括中央处理器(运算器、控制器)、存储器(内存储器、外存储器)、输入设备、输出设备;(2)符号0和1表示数据;(3)存储程序:程序存储在内存储器中,中央处理器按照存储的程序有条不紊地执行。计算机基本硬件组成如图2-2所示。2.1 逻辑代数逻辑代数在逻辑值集合T(真),F(假)上,定义了三个基本逻辑运算:(逻辑与)、(逻
2、辑或)、(逻辑非),记为。其它逻辑运算都可以用这三个基本逻辑运算表达。逻辑与也称为逻辑乘、合取,使用符号、AND、&;逻辑或也称为逻辑加、析取,使用符号+、OR、|;逻辑非也称为否定,使用符号、NOT、!。如表2-1所示,逻辑变量是取值只能为逻辑值的变量,逻辑表达式是由逻辑变量或逻辑变量与逻辑运算构成的。真值表是逻辑表达式的所有可能取值情况的罗列,如表2-1所示。采用的计数规则是低位向高位逢二进一;基数为2,第i位的位权为2i(整数部分最低位为第0位)。例1-2 (1100.011)2=123+122+12-2+12-3计算机学科也采用八进制数(Octal)和十六进制数(Hexadecimal
3、),但是在计算机中只采用二进制,引入八进制和十六进制是因为它们比二进制简洁,而且二进制与它们的转换比与十进制的转换简单。各进制数的特点如表1-1所示。2.2 数 字 电 路计算机采用数字电路,数字电路的工作信号是数字信号,数字信号只有两个数字符号:1和0。事实上,1和0只是电路的二值状态的表示,如果考虑电平的高和低,则可以用1和0表示。同理,逻辑值的真和假也可以用1和0表示,这与用T和F表示没有本质区别。总而言之,1和0可以表示任何的二值状态,1和0统一了电路状态与逻辑值,从而可以设计电路实现逻辑运算。实现逻辑与、逻辑或、逻辑非运算的电路分别称为与门、或门、非门,它们的电路符号如图2-3所示。
4、类似地,其它逻辑运算的门电路可以用这三个基本门电路组合实现,当然,也可以重新设计实现。进一步,可以用门电路组合实现计算机的其它功能部件。下面将具体介绍非门以及用门电路组合实现的触发器。2.2.1 非门MOS晶体管如图2-4所示,包括栅极(G)、漏极(D)、源极(S)。用MOS晶体管实现的非门如图2-5所示。MOS晶体管是由G的电平高低控制D、S之间处于接通还是断开状态的电子开关,当G为高电平(1)时,D与S之间导通(接通状态);当G为低电平(0)时,D与S之间截止(断开状态)。图2-5所示的非门由两个MOS晶体管V1和V2构成,其中V2是工作管(开关作用),而V1做V2的负载管,并总是处于导通
5、状态。A是输入端,F是输出端。当A输入1(高电平)时,V2导通,F输出0(低电平);当A输入0(低电平)时,V2截止,F输出1(高电平)。2.2.2 触发器触发器是可以接收并保持所接收的1或0的电路,是内存储器的基本存储元件。基本触发器如图2-6所示,左边和右边是一个与门和一个非门构成的与非门,两个与非门的输出互相反馈到对方的输入,触发器的输入端是R和S,输出端是Q和 。Q2.3 内 存 储 器根据存取方式,内存储器(Memory,也称主存储器,简称内存、主存)可以分为随机存取存储器(Random Access Memory,RAM)和只读存储器(Read Only Memory,ROM)。通
6、常所说的内存是指RAM,它是内存的主体,是计算机的信息交流中心,它可以在指定位置(内存地址)存入(写入)或者取出(读出)数据。RAM由类似触发器的存储元件组成,其存取速度快,但是只能临时存储数据,一旦断电,数据将消失。内存基本组成如图2-7所示,包括存储体、地址电路、数据电路、读/写控制电路。2.4 中央处理器2.4.1 指令系统不同计算机系统,归纳的基本操作可以不同,从而编码表示的机器指令也可以不同,即指令系统就可以不同。对于同一程序,如果两台计算机的执行结果相同,则称它们在机器指令级别兼容。事实上,一旦计算机精心归纳一些基本操作,实现了其基本能力,若再增加基本操作,则只能增加其便利性等能力
7、,而不能增加其基本能力。因此,在设计指令系统时,导致了两个方向,一个是精简指令集计算机(Reduced Instruction Set Computer,RISC),RISC中只保留了最简单、最常用的指令,这样设计的计算机效率高且速度快;另一个是复杂指令集计算机(Complex Instruction Set Computer,CISC),CISC中一些可完成复杂任务的单个指令所能实现的任务,需要多个RISC指令才能实现,因此这样设计的计算机更容易编程。不管是RISC还是CISC,归纳和编码基本操作的基本方法都是类似的,即所有基本操作都包括功能信息和数据信息。功能信息告知计算机,要执行什么操作
8、;数据信息告知计算机,操作的数据来自何处,操作的结果去向何处。当编码表示基本操作时,功能信息和数据信息分别编码,编码表示的功能信息称为操作码,编码表示的数据信息称为操作数,即机器指令包括操作码和操作数。例2-1 设两个加数分别存储于地址为X和Y的内存单元中,两个加数相加,将和存于地址为Z的内存单元中。首先,从上述问题中归纳基本操作,给出两个方案。1方案一方案一将整个问题直接作为基本操作,其功能信息是相加,数据信息是两个加数分别来自地址为X和Y的内存单元,和存于地址为Z的内存单元。当编码表示基本操作时,功能信息(操作码)的编码长度l由功能不同的基本操作的数目m决定,即l=lbm;数据信息(操作数
9、)的编码可以直接使用内存地址。这样,可以如图2-8所示安排基本操作的各个信息。在方案一中,如果内存地址的编码长度为n,则操作数的编码长度为3n,机器指令比较长。2方案二方案二引入寄存器,将这个问题分解为更小的基本操作。寄存器是中央处理器中用于临时存储数据的部件。每个寄存器有一个编号,称为寄存器地址。方案二将这个问题分解为下列三个基本操作:取数操作:从地址为X的内存单元中取出加数1,存于地址为A的寄存器中;加法操作:地址为A的寄存器中的加数1与地址为Y的内存单元中的加数2相加,和存于地址为A的寄存器中;存数操作:从地址为A的寄存器中取出和,存于地址为Z的内存单元中。可以看到,取数操作和存数操作进
10、行数据传输,真正进行两个加数相加的是加法操作。加法操作的功能信息是相加,数据信息是两个加数分别来自地址为A的寄存器和地址为Y的内存单元,和存于地址为A的寄存器中。当编码表示加法操作时,功能信息(操作码)的编码长度l由功能不同的基本操作的数目m决定,即l=lbm;数据信息(操作数)的编码可以直接使用寄存器地址和内存地址,而且加数1与和采用同一寄存器,只需表示一次。这样,可以如图2-9所示安排基本操作的各个信息。在方案二中,如果内存地址的编码长度为n,寄存器地址的编码长度为r,则操作数的编码长度为n+r。由于寄存器数量很少,一般为几个,远远少于内存单元数量,因此,r小于n,相对于方案一,方案二的机
11、器指令比较短。现在,采用方案二,编码表示基本操作得到机器指令。假设功能不同的基本操作(机器指令)的数目为16,寄存器的数目为4,内存单元的数目为1K,则操作码的编码长度至少为4位,寄存器地址至少为2位,内存地址至少为10位,机器指令长度至少为16位。如果机器指令采用16位,则机器指令格式如图2-10所示。部分机器指令的功能及为它们指派的操作码如表2-3所示。例2-1仅仅介绍了设计指令系统的基本方法,真正指令系统的设计要比这个例子复杂。根据机器指令功能,可将其分为四类:(1)数据处理类。例如,加、减、乘、除等算术运算,与、或、非等逻辑运算,左移、右移等移位运算等。(2)数据传送类。例如,中央处理
12、器与内存之间的取数据、存数据操作,主机与外部设备之间的数据输入、数据输出操作等。(3)程序控制类。例如,无条件转移与条件转移等。(4)CPU状态管理类。例如,结束等。根据机器指令格式,可以将其分为四类(OP代表操作码,X、Y、Z代表内存地址,A代表寄存器地址):(1)三地址:有三个内存地址,指令格式为(OP,X,Y,Z),可以完成(X)OP(Y)Z的操作。(2)二地址:有两个内存地址,指令格式为(OP,X,Y),可以完成(X)OP(Y)X的操作。(3)单地址:有一个内存地址,指令格式为(OP,A,X),可以完成(A)OP(X)A的操作。(4)零地址:没有内存地址,指令格式为(OP),可以完成诸
13、如结束等操作。此外,真正指令系统的操作数也有多种编码方法,称为机器指令寻址方法。寻址方式主要包括以下五种:(1)立即寻址方式:形式地址的数值不是地址,而是数据。(2)直接寻址方式:形式地址的数值是数据的有效地址。(3)间接寻址方式:形式地址的数值是数据的有效地址的地址,即根据形式地址找到一个内存单元,这个内存单元中存储了数据的有效地址,再根据该有效地址找到另一个内存单元,这个内存单元中存储了数据。(4)相对寻址方式:程序计数器的数值与形式地址的数值的和是数据的有效地址,即根据程序计数器的数值与形式地址的数值计算数据的有效地址,再根据有效地址找到一个内存单元,这个内存单元中存储了数据。这种方式主
14、要用于转移指令。(5)变址寻址方式:变址寄存器的数值与形式地址的数值的和是数据的有效地址,即根据变址寄存器的数值与形式地址的数值计算数据的有效地址,再根据有效地址找到一个内存单元,这个内存单元中存储了数据。这种方式可以扩大寻址范围。程序计数器和变址寄存器是中央处理器中用于存储内存地址的寄存器,程序计数器用于存储指令地址,而变址寄存器用于存储数据地址。2.4.2 中央处理器中央处理器(Central Processing Unit,CPU)可有条不紊地执行存储在内存中的机器指令形式的程序,完成信息处理,其执行过程如图2-11所示。当用户发出运行某程序的命令后,CPU开始执行程序,先从内存中取出第
15、一条指令进行分析并执行,再从内存中取出下一条指令进行分析并执行,这样重复,直至遇到结束指令,CPU结束程序运行。CPU的基本组成如图2-12所示,主要包括运算器和控制器。运算器用于完成算术运算和逻辑运算,主要包括算术逻辑单元和通用寄存器。数据从内存取出后送至通用寄存器或者算术逻辑单元进行算术运算或者逻辑运算,结果存于通用寄存器后送至内存。控制器用于控制计算机工作,主要包括程序计数器、指令寄存器、指令译码器和控制部件。程序计数器存储和计算下一条指令的内存地址。程序第一条指令的内存地址称为程序首地址。首先,运行程序命令将程序首地址赋予程序计数器,根据程序首地址就可以取出第一条指令。当指令取出后,程
16、序计数器自动加1计算得到下一条指令的内存地址。如果程序顺序执行,则根据这个地址就可以取出下一条指令;如果程序非顺序执行,则转移指令会将转移地址重新赋予程序计数器,从而可以根据新地址取出下一条指令。需要强调,程序计数器的自动加1不是加数值1,而是加一条机器指令长度,例如,如果一条指令长度为一个内存单元,则加1就是加数值(1)2;如果一条指令长度为两个内存单元,则加1就是加数值(10)2。指令从内存取出后送至指令寄存器,完成取指令;指令译码器分析指令的操作码,完成分析指令;根据分析结果,控制部件发出控制信号,完成执行指令。在执行指令中,如果从内存取数据,则指令的操作数指示了数据的内存地址。数据寄存
17、器用于暂时存放从内存读出的指令或数据以及向内存写入的数据。若是从内存读出的指令,则送至指令寄存器;若是数据,则送至通用寄存器或者算术逻辑单元。地址寄存器用于暂时存放即将访问的指令或数据在内存中的地址,根据这个内存地址,可以从相应内存单元中取出指令或数据。2.5 外 部 设 备2.5.1 输入设备计算机通过输入设备输入数据。输入设备种类很多,例如,键盘、鼠标、麦克风、摄像头、触摸屏、条形码阅读器、扫描仪等,可以根据需要选择配置。键盘和鼠标是基本输入设备。2.5.2 输出设备计算机通过输出设备输出数据。输出设备种类也很多,例如,显示器、音箱(耳机)、投影仪、打印机、绘图仪等,也可以根据需要选择配置
18、。显示器是基本输出设备。2.5.3 外存储器外存储器本质上是存储设备,用于长期存储大量数据,计算机可以在其上输出(写、存)数据,也可以从其上输入(读、取)数据,因此,外存储器也是特殊的输入/输出设备。外存储器种类也很多,例如,硬盘、光盘、移动硬盘、U盘等。硬盘是基本外存储器。3.1 处理器管理3.2 存 储 管 理3.3 设备管理3.4 文件管理第三章 操 作 系 统3.1 处理器管理3.1.1 程序的并发执行处理器管理的任务是当多道程序并发执行时,合理、自动地分配CPU给各道程序,以提高CPU的利用率。所谓程序的并发执行是指一组在逻辑上互相独立的程序,在执行过程中,其执行时间在客观上互相重叠
19、,即一个程序的执行尚未结束,另一程序的执行已经开始的执行方式。与此对应的是程序的顺序执行和并行执行。程序的顺序执行是指一个程序执行结束之后才开始执行下一个程序的执行方式。程序的并行执行是指在多CPU系统中,多道程序同时执行的执行方式。因此,程序的并发执行不同于并行执行,程序的并发执行是宏观上的,程序“同时”执行,微观上,程序“交替”执行。那么,程序如何并发执行以提高CPU的利用率?设有三道程序A、B、C,每道程序分成输入、处理、输出三个程序段。例如,程序A分成输入程序段AI、处理程序段AC、输出程序段AO。如果这三道程序顺序执行,则当执行输入程序段时,CPU和输出设备空闲;当执行处理程序段时,
20、输入设备和输出设备空闲;当执行输出程序段时,输入设备和CPU空闲,这样,CPU及其它系统资源利用率低下。这三道程序可以如图3-3所示地并发执行,这样,在虚线表示的某个时间段上,AO占用输出设备、BC占用CPU、CI占用输入设备,各个系统资源都充分利用。3.1.2 进程当多道程序并发执行时,程序可能“走走停停”,为了更好地控制并发执行的程序,引入了进程。进程是指程序对给定数据集,在处理器上的一次执行过程。进程与程序既相关又不相同,进程包括程序、数据和进程控制块;进程与程序不是一一对应的,一个程序可以创建多个进程,一个进程也可以由多个程序创建;进程具有动态性、生命期,因创建而产生、因调度而执行、因
21、得不到资源而暂停执行、因撤消而消亡,程序只是静态指令集合。传统进程是资源分配的基本单位,也是调度执行的基本单位。当进程切换时,系统开销较大,所以系统中的进程不能太多,切换也不能过于频繁,这就限制了并发程度,于是引入线程,线程是进程的一个实体。引入线程之后,进程继续作为资源分配的基本单位,而线程作为新的调度执行的基本单位。一个进程的多个线程可以并发执行,并且切换时的系统开销较小,从而提高了并发程度。在进程生命周期内,根据资源分配或者调度执行情况,进程可以在就绪态、执行态、阻塞态三个基本状态之间转换,如图3-4所示。(1)就绪态:进程已经获得除CPU之外的其它所需资源,一旦获得CPU即可运行,并等
22、待分配CPU的状态。(2)执行态:进程占有CPU并在CPU上执行的状态。(3)阻塞态:进程尚未获得除CPU之外的其它所需资源,即使获得CPU也无法运行,等待分配其它资源的状态。进程创建之后处于就绪态。就绪态进程可以有多个,它们排成一个就绪队列。当CPU空闲时,按照进程调度策略从就绪队列中选择一个进程分配CPU,该进程从就绪态转换为执行态。阻塞态进程可以有多个,它们的阻塞原因可能相同也可能不同,它们按照阻塞原因排成队列。当等待的事件发生时,例如,数据输入完毕,唤醒等待该事件的进程,进程从阻塞态转换为就绪态。3.1.3 进程控制因共享与竞争资源,进程之间将产生相互制约关系,主要表现为进程互斥和进程
23、同步。1进程互斥进程互斥是指一组并发进程在同一时刻要求同一临界资源而相互排斥。所谓临界资源是指一次只能供一个进程使用的资源。2进程同步进程同步是指一组并发进程为共同完成一个任务而相互合作。事实上,进程互斥和进程同步经常同时出现。如果不对并发进程所需资源的动态分配加以控制,则可能出现死锁。所谓死锁是指一组并发进程彼此互相等待对方所拥有的资源,且这组并发进程在得到对方所拥有的资源之前不会释放自己所拥有的资源,从而造成各并发进程想得到资源又得不到而不能继续向前推进的状态。为了解决死锁,系统可以破坏死锁产生的必要条件,尽可能地预防与避免死锁,系统也可以建立检测和解除死锁的机制,即当检测到死锁发生时,采
24、用资源剥夺或进程撤销解除死锁。3.2 存 储 管 理3.2.1 存储管理方案存储管理是指内存储器的管理,管理任务包括内存的分配、回收、保护及扩充。管理方案有分区存储管理、分页存储管理、虚拟存储管理、段式存储管理和段页式存储管理等。1分区存储管理分区存储管理是早期的存储管理方案,其基本思想是:把内存的用户区划分成若干区域,每个区域分配给一个用户程序使用,并限定它们只能在自己的区域中运行。区域的划分方法有固定分区、可变分区和可重定位分区等。分区存储管理要求程序装入连续的内存区域中,如果不能满足这个要求,就需要以移动区域使之连续为代价。为此,引入分页存储管理。2分页存储管理分页存储管理的基本思想是:
25、把内存空间(实际内存的存储空间)分成若干个大小相等的块。物理地址(内存地址)包括块号和块内地址,把虚拟空间(程序需要的存储空间)分成若干个大小与块相等的页;逻辑地址(虚拟空间的地址,也称为虚拟地址)包括页号和页内地址。内存分配和回收以块为单位,一个块存储一个页,逻辑上连续的页可以存储在物理上不连续的块中,采用页表存储块和页的映射关系即每个页的页号、块号等信息。上述存储管理方案,不论是分区存储管理还是分页存储管理,都要求程序整个装入内存,如果不能满足这个要求,程序就无法运行。为此,目前的存储管理采用虚拟存储管理技术,它可以提供比实际内存大得多的虚拟内存,保证多道程序的并发执行。3虚拟存储管理虚拟
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