数字电路逻辑设计课件:5-1.PPT
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- 数字电路 逻辑设计 课件
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1、5.1基本触发器5.1.2基本触发器功能的描述基本触发器功能的描述5.1.1基本触发器电路组成和工作原理基本触发器电路组成和工作原理11&G2G1QQQQSDRD(a)(b)图5- -1- -1 基本触发器电路SDRD5.1.1基本触发器电路组成和工作原理基本触发器电路组成和工作原理基本触发器电路由两基本触发器电路由两个个与非与非门(门(或非或非门)交叉门)交叉耦合组成。有两个输出端耦合组成。有两个输出端和两个输入端。和两个输入端。;触发器状态为触发器状态为时,称时,称、当当010 QQ。时,称触发器状态为时,称触发器状态为、当当101 QQ。,触发器置,触发器置,时,则时,则,当当。,触发器
2、置,触发器置,时,则时,则,当当11001)2(00110)1(DDDD QQSRQQSR端,都是低电平有效。端,都是低电平有效。为置为置端,端,为置为置因此,称因此,称01DDRS综上所述:综上所述:基本触发器具有基本触发器具有置置0(复位)(复位)、置置1(置位)(置位)和和保持保持的功能。基本触发器又称为的功能。基本触发器又称为置置0置置1触发器触发器,或称为,或称为置位复置位复位触发器位触发器。具有保持功能。具有保持功能。变,说明触发器变,说明触发器时,触发器状态保持不时,触发器状态保持不,当当11)3(DD SR。,时,则时,则,当当1100)4(DD QQSR此时如果两个输入信号同
3、时发生由此时如果两个输入信号同时发生由0到到1的变化,则会出现的变化,则会出现所谓所谓竞争现象竞争现象。由于两个。由于两个与非与非门的延迟时间无法确定,使得触门的延迟时间无法确定,使得触发器最终稳定状态也不能确定。发器最终稳定状态也不能确定。SDRDQQSR图5- -1- -5 基本触发器逻辑符号表示低电平有效。表示低电平有效。状态转移真值表状态转移真值表描述触发器在输入信号作用下,下一稳定状态(描述触发器在输入信号作用下,下一稳定状态(次态次态)Qn+1与触发器的原稳定状态(与触发器的原稳定状态(现态现态) Qn 以及输入信号之间关以及输入信号之间关系的一种表格。系的一种表格。5.1.2基本
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